系統階層設計驗證技術(System-Level Design & Verification Methodology)
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技術名稱-中文系統階層設計驗證技術(System-Level Design & Verification Methodology)的執行單位是工研院晶片中心, 產出年度是94, 計畫名稱是工研院電子資訊與通訊光電領域環境建構計畫, 技術規格是Application Analysis到Dataflow Design之設計方法；Embedded SoC/System系統架構及軟硬體分工設計方法；System-Level Performance Verification；SystemC transaction-level modeling訓..., 潛力預估是深化廠商之SoC設計能力，建立系統層級設計技術，將IP以系統層級描述，使SoC平台及IP之推廣銷售更為容易，並可擴大客戶之層級，接觸到系統架構設計師 (System Architect) 等對客戶廠商更具影響力之人員，並加深產品技術服務面。.

序號	1401
產出年度	94
技術名稱-中文	系統階層設計驗證技術(System-Level Design & Verification Methodology)
執行單位	工研院晶片中心
產出單位	(空)
計畫名稱	工研院電子資訊與通訊光電領域環境建構計畫
領域	(空)
已申請專利之國家	(空)
已獲得專利之國家	(空)
技術現況敘述-中文	傳統的做法不僅會造成重複的投片而提高成本，且由於軟體與硬體的同步驗證工作，必須在晶片製作出來以後才能執行，使得晶片的驗證週期拉得極長；對於奈米等級的晶片設計而言，由於內嵌式微處理器的盛行、晶片內含的電路閘數目增加等，都會造成驗證的成本與時間兩項重要因素進一步惡化。本技術是以系統階層設計概念為基礎，規劃從應用系統分析到軟硬體規範之系統階層設計及驗證方法，可將軟硬體之統合驗證大幅提前到系統設計初期，並提供更完善的驗證工具，簡易並縮短軟硬體驗證時程。
技術現況敘述-英文	(空)
技術規格	Application Analysis到Dataflow Design之設計方法；Embedded SoC/System系統架構及軟硬體分工設計方法；System-Level Performance Verification；SystemC transaction-level modeling訓練
技術成熟度	本技術已建立完整之SoC系統層級模擬設計平台，包含如ARM926EJS、ARM920T、STC DSP、DMAC、SDRAM、VIC等IP，也曾與學校合作，協助開發ESL Design Lab課程基礎教材，目前可隨時技轉給廠商。
可應用範圍	數位Embeddes SoC/System設計，如H.264、MPEG4、WiMax、WCDMA、GSM等等。
潛力預估	深化廠商之SoC設計能力，建立系統層級設計技術，將IP以系統層級描述，使SoC平台及IP之推廣銷售更為容易，並可擴大客戶之層級，接觸到系統架構設計師 (System Architect) 等對客戶廠商更具影響力之人員，並加深產品技術服務面。
聯絡人員	林秀玲
電話	03-591-4063
傳真	03-591-3183
電子信箱	AustenLin@itri.org.tw
參考網址	http://www.itri.org.tw/
所須軟硬體設備	(空)
需具備之專業人才	Circuit design engineer and CAD engineer

序號

1401

產出年度

技術名稱-中文

系統階層設計驗證技術(System-Level Design & Verification Methodology)

執行單位

工研院晶片中心

產出單位

(空)

計畫名稱

工研院電子資訊與通訊光電領域環境建構計畫

領域

(空)

已申請專利之國家

(空)

已獲得專利之國家

(空)

技術現況敘述-中文

傳統的做法不僅會造成重複的投片而提高成本，且由於軟體與硬體的同步驗證工作，必須在晶片製作出來以後才能執行，使得晶片的驗證週期拉得極長；對於奈米等級的晶片設計而言，由於內嵌式微處理器的盛行、晶片內含的電路閘數目增加等，都會造成驗證的成本與時間兩項重要因素進一步惡化。本技術是以系統階層設計概念為基礎，規劃從應用系統分析到軟硬體規範之系統階層設計及驗證方法，可將軟硬體之統合驗證大幅提前到系統設計初期，並提供更完善的驗證工具，簡易並縮短軟硬體驗證時程。

技術現況敘述-英文

(空)

技術規格

Application Analysis到Dataflow Design之設計方法；Embedded SoC/System系統架構及軟硬體分工設計方法；System-Level Performance Verification；SystemC transaction-level modeling訓練

技術成熟度

本技術已建立完整之SoC系統層級模擬設計平台，包含如ARM926EJS、ARM920T、STC DSP、DMAC、SDRAM、VIC等IP，也曾與學校合作，協助開發ESL Design Lab課程基礎教材，目前可隨時技轉給廠商。

可應用範圍

數位Embeddes SoC/System設計，如H.264、MPEG4、WiMax、WCDMA、GSM等等。

潛力預估

深化廠商之SoC設計能力，建立系統層級設計技術，將IP以系統層級描述，使SoC平台及IP之推廣銷售更為容易，並可擴大客戶之層級，接觸到系統架構設計師 (System Architect) 等對客戶廠商更具影響力之人員，並加深產品技術服務面。

聯絡人員

林秀玲

電話

03-591-4063

傳真

03-591-3183

電子信箱

AustenLin@itri.org.tw

參考網址

http://www.itri.org.tw/

所須軟硬體設備

(空)

需具備之專業人才

Circuit design engineer and CAD engineer

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應用於CMOS製程之射頻積體電路之靜電放電防護電路設計

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